FPGA矿机如何制作

『壹』 利用FPGA资源制作想要的位宽、深度和不同读写端口的RAM器件。 即完成FPGA中RAM的定制，请问怎么做

这是我以前写的一个标准双端口ram，可以作为单端口或者双端口用
library ieee;
use ieee.std_logic_1164.all;
use IEEE.STD_LOGIC_ARITH.all;
use IEEE.STD_LOGIC_UNSIGNED.all;

entity blk_mem is
generic(
data_width : integer := 8; -- used to change the memory data's width
addr_width : integer := 11); -- used to change the memery address' width
port (
clka : in std_logic;
dina : in std_logic_vector(data_width - 1 downto 0);
addra : in std_logic_vector(addr_width - 1 downto 0);
ena : in std_logic;
wea : in std_logic;
douta : out std_logic_vector(data_width - 1 downto 0);
clkb : in std_logic;
dinb : in std_logic_vector(data_width - 1 downto 0);
addrb : in std_logic_vector(addr_width - 1 downto 0);
enb : in std_logic;
web : in std_logic;
doutb : out std_logic_vector(data_width - 1 downto 0));
end blk_mem;

architecture blkmem of blk_mem is

type ram_template is array(2 ** addr_width - 1 downto 0) of std_logic_vector(data_width - 1 downto 0);
shared variable ram1 : ram_template;

begin -- blkmem

process (clka)
begin -- process
if clka'event and clka = '1' then -- rising clock edge
if ena = '1' then
douta <= ram1(conv_integer(addra));
if wea = '1' then
ram1(conv_integer(addra)) := dina;
end if;
else
douta <= (others => '0');
end if;
end if;
end process;

process (clkb)
begin -- process
if clkb'event and clkb = '1' then -- rising clock edge
if enb = '1' then
doutb <= ram1(conv_integer(addrb));
if web = '1' then
ram1(conv_integer(addrb)) := dinb;
end if;
else
doutb <= (others => '0');
end if;
end if;
end process;

end blkmem;

『贰』 FPGA做视频处理 需要哪些资料

我常年担任多个有关FPGA学习研讨的QQ群管理员，长期以来很多新入群的菜鸟们总是在重复的问一些非常简单但是又让新手困惑不解的问题。作为管理员经常要给这些菜鸟们普及基础知识，但是非常不幸的是很多菜鸟怀着一种浮躁的心态来学习FPGA，总是急于求成。再加上国内大量有关FPGA的垃圾教材的误导，所以很多菜鸟始终无法入门。

为什么大量的人会觉得FPGA难学？作为著名FPGA提供商Altera授权的金牌培训师，本管理员决心开贴来详细讲一下菜鸟觉得FPGA难学的几大原因。
1、不熟悉FPGA的内部结构，不了解可编程逻辑器件的基本原理。
FPGA为什么是可以编程的？恐怕很多菜鸟不知道，他们也不想知道。因为他们觉得这是无关紧要的。他们潜意识的认为可编程嘛，肯定就是像写软件一样啦。软件编程的思想根深蒂固，看到Verilog或者VHDL就像看到C语言或者其它软件编程语言一样。一条条的读，一条条的分析。如果这些菜鸟们始终拒绝去了解为什么FPGA是可以编程的，不去了解FPGA的内部结构，要想学会FPGA恐怕是天方夜谭。虽然现在EDA软件已经非常先进，像写软件那样照猫画虎也能综合出点东西，但也许只有天知道EDA软件最后综合出来的到底是什么。也许点个灯，跑个马还行。这样就是为什么很多菜鸟学了N久以后依然是一个菜鸟的原因。
那么FPGA为什么是可以“编程”的呢？首先来了解一下什么叫“程”。启示“程”只不过是一堆具有一定含义的01编码而已。编程，其实就是编写这些01编码。只不过我们现在有了很多开发工具，通常都不是直接编写这些01编码，而是以高级语言的形式来编写，最后由开发工具转换为这种01编码而已。对于软件编程而言，处理器会有一个专门的译码电路逐条把这些01编码翻译为各种控制信号，然后控制其内部的电路完成一个个的运算或者是其它操作。所以软件是一条一条的读，因为软件的操作是一步一步完成的。
而FPGA得可编程，本质也是依靠这些01编码实现其功能的改变，但不同的是FPGA之所以可以完成不同的功能，不是依靠像软件那样将01编码翻译出来再去控制一个运算电路，FPGA里面没有这些东西。FPGA内部主要三块：可编程的逻辑单元、可编程的连线和可编程的IO模块。可编程的逻辑单元是什么？其基本结构某种存储器（SRAM、FLASH等）制成的4输入或6输入1输出地“真值表”加上一个D触发器构成。任何一个4输入1输出组合逻辑电路，都有一张对应的“真值表”，同样的如果用这么一个存储器制成的4输入1输出地“真值表”，只需要修改其“真值表”内部值就可以等效出任意4输入1输出的组合逻辑。这些“真值表”内部值是什么？就是那些01编码而已。如果要实现时序逻辑电路怎么办？这不又D触发器嘛，任何的时序逻辑都可以转换为组合逻辑 D触发器来完成。但这毕竟只实现了4输入1输出的逻辑电路而已，通常逻辑电路的规模那是相当的大哦。那怎么办呢？这个时候就需要用到可编程连线了。在这些连线上有很多用存储器控制的链接点，通过改写对应存储器的值就可以确定哪些线是连上的而哪些线是断开的。者就可以把很多可编程逻辑单元组合起来形成大型的逻辑电路。最后就是可编程的IO，这其实是FPGA作为芯片级使用必须要注意的。任何芯片都必然有输入引脚和输出引脚。有可编程的IO可以任意的定义某个非专用引脚（FPGA中有专门的非用户可使用的测试、下载用引脚）为输入还是输出，还可以对IO的电平标准进行设置。
总归一句话，FPGA之所以可编程是因为可以通过特殊的01代码制作成一张张“真值表”，并将这些“真值表”组合起来以实现大规模的逻辑功能。不了解FPGA内部结构，就不能明白最终代码如何变到FPGA里面去的。也就无法深入的了解如何能够充分运用FPGA。现在的FPGA，不单单是有前面讲的那三块，还有很多专用的硬件功能单元，如何利用好这些单元实现复杂的逻辑电路设计，是从菜鸟迈向高手的路上必须要克服的障碍。而这一切，还是必须先从了解FPGA内部逻辑及其工作原理做起。
2、错误理解HDL语言，怎么看都看不出硬件结构。
HDL语言的英语全称是：Hardware Description Language，注意这个单词Description，而不是Design。老外为什么要用Description这个词而不是Design呢？因为HDL确实不是用用来设计硬件的，而仅仅是用来描述硬件的。描述这个词精确地反映了HDL语言的本质，HDL语言不过是已知硬件电路的文本表现形式而已，只是将以后的电路用文本的形式描述出来而已。而在编写语言之前，硬件电路应该已经被设计出来了。语言只不过是将这种设计转化为文字表达形式而已。但是很多人就不理解了，既然硬件都已经被设计出来了，直接拿去制作部就完了，为什么还要转化为文字表达形式再通过EDA工具这些麻烦的流程呢？其实这就是很多菜鸟没有了解设计的抽象层次的问题，任何设计包括什么服装、机械、广告设计都有一个抽象层次的问题。就拿广告设计来说吧，最初的设计也许就是一个概念，设计出这个概念也是就是一个点子而已，离最终拍成广告还差得很远。
硬件设计也是有不同的抽象层次，没一个层次都需要设计。最高的抽象层次为算法级、然后依次是体系结构级、寄存器传输级、门级、物理版图级。使用HDL的好处在于我们已经设计好了一个寄存器传输级的电路，那么用HDL描述以后转化为文本的形式，剩下的向更低层次的转换就可以让EDA工具去做了，者就大大的降低了工作量。这就是可综合的概念，也就是说在对这一抽象层次上硬件单元进行描述可以被EDA工具理解并转化为底层的门级电路或其他结构的电路。在FPGA设计中，就是在将这以抽象层级的意见描述成HDL语言，就可以通过FPGA开发软件转化为问题1中所述的FPGA内部逻辑功能实现形式。HDL也可以描述更高的抽象层级如算法级或者是体系结构级，但目前受限于EDA软件的发展，EDA软件还无法理解这么高的抽象层次，所以HDL描述这样抽象层级是无法被转化为较低的抽象层级的，这也就是所谓的不可综合。
所以在阅读或编写HDL语言，尤其是可综合的HDL，不应该看到的是语言本身，而是要看到语言背后所对应的硬件电路结构。如果看到的HDL始终是一条条的代码，那么这种人永远摆脱不了菜鸟的宿命。假如哪一天看到的代码不再是一行行的代码而是一块一块的硬件模块，那么恭喜脱离了菜鸟的级别，进入不那么菜的鸟级别。
3、FPGA本身不算什么，一切皆在FPGA之外
这一点恐怕也是很多学FPGA的菜鸟最难理解的地方。FPGA是给谁用的？很多学校解释为给学微电子专业或者集成电路设计专业的学生用的，其实这不过是很多学校受资金限制，卖不起专业的集成电路设计工具而用FPGA工具替代而已。其实FPGA是给设计电子系统的工程师使用的。这些工程师通常是使用已有的芯片搭配在一起完成一个电子设备，如基站、机顶盒、视频监控设备等。当现有芯片无法满足系统的需求时，就需要用FPGA来快速的定义一个能用的芯片。前面说了，FPGA里面无法就是一些“真值表”、触发器、各种连线以及一些硬件资源，电子系统工程师使用FPGA进行设计时无非就是考虑如何将这些以后资源组合起来实现一定的逻辑功能而已，而不必像IC设计工程师那样一直要关注到最后芯片是不是能够被制造出来。本质上和利用现有芯片组合成不同的电子系统没有区别，只是需要关注更底层的资源而已。
要想把FPGA用起来还是简单的，因为无法就是那些资源，在理解了前面两点再搞个实验板，跑跑实验，做点简单的东西是可以的。而真正要把FPGA用好，那光懂点FPGA知识就远远不够了。因为最终要让FPGA里面的资源如何组合，实现何种功能才能满足系统的需要，那就需要懂得更多更广泛的知识。
目前FPGA的应用主要是三个方向：第一个方向，也是传统方向主要用于通信设备的高速接口电路设计，这一方向主要是用FPGA处理高速接口的协议，并完成高速的数据收发和交换。这类应用通常要求采用具备高速收发接口的FPGA，同时要求设计者懂得高速接口电路设计和高速数字电路板级设计，具备EMC/EMI设计知识，以及较好的模拟电路基础，需要解决在高速收发过程中产生的信号完整性问题。FPGA最初以及到目前最广的应用就是在通信领域，一方面通信领域需要高速的通信协议处理方式，另一方面通信协议随时在修改，非常不适合做成专门的芯片。因此能够灵活改变功能的FPGA就成为首选。到目前为止FPGA的一半以上的应用也是在通信行业。
第二个方向，可以称为数字信号处理方向或者数学计算方向，因为很大程度上这一方向已经大大超出了信号处理的范畴。例如早就在2006年就听说老美将FPGA用于金融数据分析，后来又见到有将FPGA用于医学数据分析的案例。在这一方向要求FPGA设计者有一定的数学功底，能够理解并改进较为复杂的数学算法，并利用FPGA内部的各种资源使之能够变为实际的运算电路。目前真正投入实用的还是在通信领域的无线信号处理、信道编解码以及图像信号处理等领域，其它领域的研究正在开展中，之所以没有大量实用的主要原因还是因为学金融的、学医学的不了解这玩意。不过最近发现欧美有很多电子工程、计算机类的博士转入到金融行业，开展金融信号处理，相信随着转入的人增加，FPGA在其它领域的数学计算功能会更好的发挥出来，而我也有意做一些这些方面的研究。不过国内学金融的、学医的恐怕连数学都很少用到，就不用说用FPGA来帮助他们完成数学运算了，这个问题只有再议了。
第三个方向就是所谓的SOPC方向，其实严格意义上来说这个已经在FPGA设计的范畴之内，只不过是利用FPGA这个平台搭建的一个嵌入式系统的底层硬件环境，然后设计者主要是在上面进行嵌入式软件开发而已。设计对于FPGA本身的设计时相当少的。但如果涉及到需要在FPGA做专门的算法加速，实际上需要用到第二个方向的知识，而如果需要设计专用的接口电路则需要用到第一个方向的知识。就目前SOPC方向发展其实远不如第一和第二个方向，其主要原因是因为SOPC以FPGA为主，或者是在FPGA内部的资源实现一个“软”的处理器，或者是在FPGA内部嵌入一个处理器核。但大多数的嵌入式设计却是以软件为核心，以现有的硬件发展情况来看，多数情况下的接口都已经标准化，并不需要那么大的FPGA逻辑资源去设计太过复杂的接口。而且就目前看来SOPC相关的开发工具还非常的不完善，以ARM为代表的各类嵌入式处理器开发工具却早已深入人心，大多数以ARM为核心的SOC芯片提供了大多数标准的接口，大量成系列的单片机/嵌入式处理器提供了相关行业所需要的硬件加速电路，需要专门定制硬件场合确实很少。通常是在一些特种行业才会在这方面有非常迫切的需求。即使目前Xilinx将ARM的硬核加入到FPGA里面，相信目前的情况不会有太大改观，不要忘了很多老掉牙的8位单片机还在嵌入式领域混呢，嵌入式主要不是靠硬件的差异而更多的是靠软件的差异来体现价值的。我曾经看好的是cypress的Psoc这一想法。和SOPC系列不同，Psoc的思想史载SOC芯片里面去嵌入那么一小块FPGA，那这样其实可以满足嵌入式的那些微小的硬件接口差异，比如某个运用需要4个USB，而通常的处理器不会提供那么多，就可以用这么一块FPGA来提供多的USB接口。而另一种运用需要6个UART，也可以用同样的方法完成。对于嵌入式设计公司来说他们只需要备货一种芯片，就可以满足这些设计中各种微小的差异变化。其主要的差异化仍然是通过软件来完成。但目前cypress过于封闭，如果其采用ARM作为处理器内核，借助其完整的工具链。同时开放IP合作，让大量的第三方为它提供IP设计，其实是很有希望的。但目前cypress的日子怕不太好过，Psoc的思想也不知道何时能够发光。
4、数字逻辑知识是根本。
无论是FPGA的哪个方向，都离不开数字逻辑知识的支撑。FPGA说白了是一种实现数字逻辑的方式而已。如果连最基本的数字逻辑的知识都有问题，学习FPGA的愿望只是空中楼阁而已。而这，恰恰是很多菜鸟最不愿意去面对的问题。数字逻辑是任何电子电气类专业的专业基础知识，也是必须要学好的一门课。很多人无非是学习了，考个试，完了。如果不能将数字逻辑知识烂熟于心，养成良好的设计习惯，学FPGA到最后仍然是雾里看花水中望月，始终是一场空的。

以上四条只是我目前总结菜鸟们在学习FPGA时所最容易跑偏的地方，FPGA的学习其实就像学习围棋一样，学会如何在棋盘上落子很容易，成为一位高手却是难上加难。要真成为李昌镐那样的神一般的选手，除了靠刻苦专研，恐怕还确实得要一点天赋。

『叁』 基于FPGA/GPLD的流水灯制作

整体思路就是计数分频，计数，译码输出我们做数电课程设计的题目：如果你要参考的话留下邮箱，整个工程发给你好了。题目3 多功能流水灯一、任务 设计一个彩灯流水控制电路，其主要部分实现定时功能，即在预定的时间到来时，如何产生一个控制信号控制彩灯的流向、间歇等，可通过利用中规模集成电路中可逆计数器和译码器来实现正、逆流水功能，利用组合电路实现自控、手控、流向控制等功能。二、设计要求1、基本要求（1）用 8 个发光二极管作为彩灯显示，设计一个彩灯控制电路，能使彩灯的流向可以变化。具有彩灯亮点的右移、左移、全亮及全灭等功能。灯流动的方向可以手控也可以自控，自控往返变换时间为5秒。（2）彩灯可以间歇流动，10秒间歇1次，间歇时间1秒。2、发挥部分（1）彩灯流速可以改变。（2）设计显示图案循环的控制电路。 1.要求有手控和自控功能，即手控和自控都要实现。 2.手控按一个键，LED移动一位。也可再加其他键，按一下完成左移或右移等一个连续动作（如从第一位移到第八位）。 3.自控往返变换时间为5秒，是要求右移后左移，右移+左移共用5秒。 三、报告要求1、设计方案选取与论证 提出选择所选方案的理由、指出方案的可行性、优缺点，画出整机的原理框图。 2、单元电路设计 画出各单元电路的电路图，简述各单元电路的工作原理，重点是电路主要参数的计算和功能分析。3、*系统功能仿真验证和印制版图的设计（选做）简述系统功能仿真验证结果及仿真结果分析；印制版图的设计和印制版图。4、硬件的装配和调试装配和调试中的问题和解决办法，简述调试结果。5、结果分析和总结系统实现的实际功能指标，达标情况，特点和问题分析。作品的优缺点、特色和创新点的自我评价。

『肆』 做FPGA挖矿机，现在还能做什么币

FPGA免费，貌似挖矿很费电，淘宝上好像有卖资料程序的以前

『伍』 怎么制作xilinxfpga开发板

材料清单:

1. FPGA(CPLD)芯片 Xilinx XC9536xl
单价不到10元
(选PLCC44封装的，加一个插座1-2元)
2.Xilinx下载线(FPGA的并口下载线一般都是30-50元)
(一般是10头输出，要买一个相应的插座，双排插针也可)
3.一块单孔实验板(10元以内)
4.三端稳压块(3.3V，1-2元)
5.9V的整流器(10元)
6.其他电源插座开关，滤波电容等(5元)以内
7.Xilinx
ISE WAB版开发软件(免费下载)
8.可以买一些LED,
按钮开关等等
以上成本合计不到100元，你就可以开始设计调试你自己的FPGA模块了
具体做法
1.电源是必不可少的，用三端稳压块做电源极其简单
(建议做成单独的电源板，地线问题和滤波比较有讲究，
初期可先忽略，但在产品开发时是第一要务)
2.把FPGA的插座焊接到单孔(焊盘互不相连)的实验版上
3.把十针插座或5组双排针焊接在实验板上
4.根据产品手册，把FPGA的电源和地线连接好
(养成一个遇到电源就加去耦合电容的好习惯，典型的0.1u)
5.根据产品手册，把FPGA的TDI,
TDO, TMS,
TCK四条线与
下载线插座上的相应插针相连
同时把插座上注明的电源和地也连上(大概7条线)
6.把芯片放入插座中，把下载线连接好(计算机并口到插座)
电源上电
7.可以直接进入ISP对FPGA进行编程和下载
8.编程下载完成后，摘掉下载线，你的FPGA开发板
(同时也是工作板)就可以直接工作了

『陆』 在FPGA上制作一个9秒的计数器。

using counter directly.

clock freq = 50MHz,
output freq = 1/9 Hz
counter width = ceil(log2(9*450*10^6)) = 29

CONSTANT cnt_norm : UNSIGNED(28 DOWNTO 0) := TO_UNSIGNED(9*450*(10**6)-1, 29);
SIGNAL counter : UNSIGNED(28 DOWNTO 0) := (OTHERS=>'0');
SIGNAL pulse : STD_LOGIC := '0';

cnt_proc: PROCESS(clk)
BEGIN
IF RISING_EDGE(clk) THEN
IF counter = cnt_norm THEN
counter <= (OTHERS=>'0');
pulse <= '1';
ELSE
counter <= counter + 1;
pulse <= '0';
END IF;
END IF;
END PROCESS;

『柒』 怎么用FPGA制作语音报时模块

比较简单办法是采用语言芯片+FPGA。
如果只用FPGA，还需要数模转换芯片，因此这个方案并不简单。

『捌』 比特币矿机的工作原理，是否是通过电脑发送难度给FPGA、ASIC，然后由矿机算出难度，传到电脑

挖矿的目的就是为交易块打包。打包成功了，你就开出一个新的包包，获得25比特币的奖励，以及未来加进这个包的交易的手续费。

然后其他的矿工就开始为你这个新包产生的交易打包直到下一个包的出先。

以后的比特币挖矿产能小，甚至变零了，你是还有交易费收的。 系统永远需要”矿工“，矿机还是会存在的。

『玖』 FPGA能做出显卡吗如果可以，可以做到最高什么程度的显卡

首先是FPGA的级别。现在老外的挖矿卡什么的用的都是低成本FPGA，如spartan系列。如果要性能就要用高性能的FPGA，如Vertex系列, Stratix系列，计算密度和速度都高几十倍。

其次是定位。FPGA的优势是定点和逻辑，不在复杂的浮点运算。

『拾』 用FPGA和51单片机制作DDS信号发生器的疑惑：

51跟FPGA的管脚电平不一样，要一个做一个电平匹配板，在51那里输入想要的波形数据，确定之后发送到FPGA，至于你要怎么传送都行，可以将数据一次8位送也可以1位送或者其它，FPGA接收到数据之后整合恢复成原来的数据，存入你的RAM中想要怎么用就怎么用；调频调幅的数据也是跟波形数据一样的方式处理就行了